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Asic design - Verilog/HDL code -Design

$250-750 USD

Cancelado
Publicado hace alrededor de 7 años

$250-750 USD

Pagado a la entrega
Analyze, design, synthesize, and simulate logic circuits using Verilog-HDL and different widely-used tools such as ModelSim
ID del proyecto: 14010489

Información sobre el proyecto

2 propuestas
Proyecto remoto
Activo hace 7 años

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hi sir i do my final year project on FPGA kit my project was to build 8 bit processor on FPGA kit. i have great experience of verilog i can easily do that. Accept my offer thanks Note that I study special coerce of 4 credit hour with lab "ASIC Design and FPGA " .
$555 USD en 15 días
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Hi, Can we discuss the project further? I have done similar project and understood the project outline. Please give me a chance. A trial will convince you. Looking forward to work with you.
$555 USD en 10 días
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Bandera de KUWAIT
Farawaniyah, Kuwait
4,9
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