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Freelancer Empleos Verilog / VHDL
DVLSI project 'ASIC design of face detection using haar wavelet'.

DVLSI project 'ASIC design of face detection using haar wavelet'.

₹600-1500 INR

Cerrado
Publicado hace más de 4 años

₹600-1500 INR

Pagado a la entrega
DVLSI project 'ASIC design of face detection using haar wavelet'. Use verilog, FPGA and Viola Jones algorithm
Verilog / VHDL
FPGA
Engineering
ID del proyecto: 21745762

Información sobre el proyecto

1 propuesta
Proyecto remoto
Activo hace 5 años

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1 freelancer está ofertando un promedio de ₹12.500 INR por este trabajo
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@Ahmed8033
Bandera de RUSSIAN FEDERATION
Hi, i have seen your project, i have experience in Verilog coding, I have also experience with Image processing.
₹12.500 INR en 7 días
5,0 (1 comentario)
0,3
0,3

Sobre este cliente

Bandera de INDIA
Jalandhar, India
0,0
0
Miembro desde ene 7, 2015

Verificación del cliente

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$250-750 USD
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